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设有三个处理机A，B和C。它们各有一个高速缓冲存储器CA，CB和CC，并各有一个主存储器MA，MB和MC，其性能如表2-5所示。假定三个处理机的指令系统相同，它们的指令执行时间与存储器平均存取周期成正比。如果执行某个程序时，所需的指令或数据在缓冲存储器中取到的概率是P＝0.6，那么这三个处理机按处

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