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verilog如何表示缺省的数字呢?比如case({op,funct,rt}){BEQop,6'bxxxxxx,5'bxxxxx}:ALUCode=alubeq;{BNEop,6'bxxxxxx,5'bxxxxx}:ALUCode=alubne;我想表示当funct和其他

ct和rt为任意值时,只要o

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